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使用有安全保障的閃存存儲構建安全的汽車系統

使用有安全保障的閃存存儲構建安全的汽車系統

在現代汽車嵌入式系統中，高度安全的數據存儲是必不可少的，尤其是在面對日益高明的網絡攻擊時。本文將介紹設計師正確使用閃存的步驟。

最新設計資源

STRS系統異構處理器通信中間件的設計與實現[其他][其他]

針對空間通信無線電系統（STRS）異構處理器間通信存在的實時性不高、冗余度較大、無法故障恢復等問題，將分布式數據分發服務（DDS）中間件技術引入到STRS架構中，實現STRS異構處理器波形應用組件之間基于發布/訂閱模式的通信中間件。在完全兼容STRS標準規范的前提下，有效地提高了基于STRS的通信系統消息傳遞的實時性，降低了系統的復雜度和冗余度，提高了開發效率，節省了系統的開發和維護成本，實現了全局和局部模塊的動態重構。

發表于：3/1/2023

基于TSDM的抗時間維度隨機化方法研究[其他][其他]

時間維度隨機化技術通過插入隨機延遲、冗余操作和變頻時鐘等操作，使得側信息在時域難以對齊，進而降低了側信道攻擊效率。針對時間維度隨機化技術引起的能量跡時域失調的問題，提出了基于趨勢序列動態匹配（Trend Series Dynamic Matching， TSDM）的抗時間維度隨機化方法，分析了攻擊興趣點的分布，提取了能量跡的趨勢信息，刻畫了能量跡的形狀特征，壓縮了能量跡的維度，抑制了噪聲的負面影響，實現了數據的動態對齊，進而提高側信道攻擊的效率。面向3種典型時間隨機化技術開展方法驗證和性能分析，該方法相較多種經典對齊方法在不同噪聲環境下的數據對齊效果更好，能量攻擊成功率達到100%所需的能量跡數量分別減少了23.8%、24.2%、11.3%。

發表于：3/1/2023

飛機油料加注加油車智能派工設計方法研究[其他][航空航天]

隨著民航業的飛速發展，給飛機加注油料的保障任務越來越多。目前，飛機加油任務主要由油料供應商調度員根據航班加油信息逐一分配加油任務給加油員，加油員收到任務后駕駛加油保障車輛到達飛機位置進行加油作業。加油業務電子化、信息化、大數據分析等技術的實現逐漸打通了加油系統的信息通道。基于大量多維數據，根據飛機加油業務特點，提供一種用于飛機油料加注加油車的智能派工方法，能夠自動進行加油任務分配，避免出現航班延誤狀況及就此造成的嚴重資源浪費并能減輕調度員工作量。通過智能派工可以合理調配加油資源，保證飛機及時加油，順利完成航班保障任務。

發表于：3/1/2023

多維工控系統網絡安全風險監測預警系統研究與應用[通信與網絡][信息安全]

網絡安全已成為關系國家安全和發展、關系人民群眾切身利益的重大問題，網絡安全形勢也是日益嚴峻，網絡攻擊危害政治安全、社會穩定、經濟發展、文化建設，網絡空間的國際競爭方興未艾。從多個維度對潛在的網絡風險進行識別和預警，在攻擊成功之前采取有效措施迅速阻斷攻擊，是工控系統安全穩定運行的有力保障。

發表于：3/1/2023

如何安全實現車載網絡通信?[通信與網絡][汽車電子]

當我告訴人們我從事專注于汽車安全的半導體行業時，他們通常認為一定會涉及汽車報警和車鑰匙。盡管汽車盜竊仍是一個合理的擔憂，但與內部電子控制單元(ECU)及其車內外通信相關的安全威脅明顯更大。在今年銷售的所有新車中，大約有50%的車輛支持聯網功能，很多人估計到2030年，這一數字將達到95%左右。

發表于：3/1/2023

基于盲均衡技術的寬帶IQ不平衡補償設計與實現[其他][其他]

針對寬帶信號的IQ不平衡問題，給出了基于盲均衡技術的補償設計方法。該方法通過改進高速解調器的均衡器設計，采用自適應盲均衡技術計算IQ不平衡補償濾波器，使得均衡器同時具有IQ不平衡補償和減小碼間串擾的功能。在工程應用中，該方法不會增加額外的資源消耗和硬件設計復雜度。測試結果表明，該方法可適用于多種調制方式信號，能有效補償IQ不平衡。

發表于：2/28/2023

基于組播通信的PBFT算法改進[通信與網絡][通信網絡]

PBFT算法存在通信復雜度高、性能受節點增加而下降等問題，引入組播通信應用于RPBFT（基于角色的拜占庭共識機制），提出了一種通信復雜度低、可以動態分配共識節點、不因節點數增加而性能下降的WRPBFT共識算法。WRPBFT將節點劃分為共識節點和候選節點兩類節點，動態地選取參與共識的共識節點進行組播通信。實驗與分析表明，WRPBFT共識算法可以動態地實現節點的劃分與選取，并且相較傳統PBFT算法，WRPBFT算法具備更高吞吐量、更低的時延和更低的通信復雜度。

發表于：2/28/2023

基于PSO的恒力執行器PID型模糊控制器[其他][其他]

針對打磨機器人在打磨過程中對恒力控制精度和響應速度的要求，提出了一種基于粒子群優化算法的恒力執行器PID型模糊控制器。設計新型PID型模糊控制器，減少設計規則庫數量；提出變權重綜合型適應度函數，結合誤差積分絕對值和控制信號積分絕對值優化PID型模糊控制器的綜合性能，同時減小超調量與穩態誤差；采用自適應慣性權重策略加快粒子群迭代速度，使用粒子群算法對PID型模糊控制的比例因子進行優化。仿真結果表明，經過粒子群優化的PID型模糊控制實現了打磨力的平穩輸出，響應速度提升10%，調節時間縮短14%，系統無超調、無振蕩，提高了打磨力的控制精度。

發表于：2/28/2023

芯片樣品驗證平臺自適應和同步測試功能的設計與實現[測試測量][消費電子]

目前，芯片設計公司在對量產級的芯片進行樣品驗證時，傳統的樣品驗證方法大多是基于芯片自身特點來設計相應的測試設備，然后通過測試夾具對芯片樣品逐一測試，不同的芯片會設計不同的測試設備。提出了一種自適應且可同步測試的樣品驗證平臺方案，既可以實現同時測試多顆芯片，也可以對不同接口的芯片進行測試；既可以進行可靠性實驗測試，也可以進行其他功能的測試，大大節省了測試設備的維護成本，提高測試效率。

發表于：2/28/2023

一種框架類測角裝置內環組件靜平衡調試方法[其他][其他]

導引頭位置標定系統是一種框架類測角裝置，其內環組件的靜平衡度直接決定產品性能的穩定。充分利用壓力傳感器的優勢，通過HX711進行模數轉換、數據采集，將采集的結果顯示在液晶顯示屏上，并對數據分析處理，設計了一款自動測量導引頭位置標定系統內框架靜平衡的裝置。該裝置通過內嵌的4個壓力傳感器，實現產品內框架在平衡刀架上放置時，若產品不平衡，由于重力的作用，內框架某一端會壓在平衡裝置上，通過顯示壓力值的大小，利用最小二乘法擬合，實現壓力值與產品增減墊片厚度值的關系式，并驗證關系式的一般性，實現一次計算即可實現某導引頭位置標定系統內框架靜平衡的準確調試。

發表于：2/28/2023

基于OCP的輕量級多主從跨時鐘域片上總線設計[其他][其他]

開放芯核協議（Open Core Protocol，OCP）總線可被應用于將IP核功能與接口解耦，實現IP核的即插即用。針對OCP連接到異步時鐘域時的同步問題，改進設計了輕量化的同步接口，在同步化控制信息的同時降低了跨時鐘域緩存數據導致的硬件消耗。為解決點到點的OCP總線的擴展性不足的缺陷，將設計的跨時鐘域OCP總線部署于共享總線互聯的高級高性能總線（AMBA High-performance Bus，AHB），實現了多主從多時鐘域傳輸。仿真和驗證表明，設計的改進跨時鐘域OCP-AHB總線可以正確傳輸數據，可用于其他工作的快速部署。

發表于：2/28/2023

基于RISC-V的AES密碼加速引擎設計與驗證[可編程邏輯][信息安全]

隨著物聯網技術的快速發展和物聯網設備的廣泛部署，信息安全問題日益凸顯。密碼是保障信息安全的關鍵核心技術，但傳統的密碼算法適配方案存在性能和靈活性難以兼顧的問題，提出了一種密碼指令擴展方案在兩者之間取得了很好的平衡。首先分析了AES算法的運算環節，結合蜂鳥E203處理器架構，提出了密碼指令擴展和加速引擎設計方案；接著進行了軟硬件實現，構建了RTL級仿真環境和FPGA板級驗證環境；最后進行了實驗驗證和對比分析。實驗結果表明，提出的方案在只增加接近2%的硬件資源的情況下可以取得約700%的加速比，具有較高的能效，可適用于在物聯網等資源受限的場合。

發表于：2/28/2023

基于芯片封裝的微系統模塊PDN設計優化[電源技術][智能電網]

隨著IC芯片的供電電源趨向低電壓以及大電流，基于2.5D硅通孔技術（Through-Silicon-Via，TSV）、倒扣焊、高溫共燒陶瓷（High Temperature Co-fired Ceramics，HTCC）、3D堆疊等的微系統模塊的電源分配系統（Power Delivery Network，PDN）的設計越來越重要。芯片電流經過PDN互連產生輸出噪聲，這些互連必須提供一個較優低阻抗的信號返回路徑，保持芯片焊盤間恒定的供電電壓且維持在一個很小的容差范圍內，通常在5%以內?；谛酒庋b系統（Chip Package System， CPS），結合TSV硅基板、HTCC管殼、PCB三級協同對微系統模塊PDN提出設計及優化方法，從直流設計、交流阻抗設計分別進行闡述，并運用芯片電源模型（Chip Power Model， CPM），結合時域分析實現了電源紋波PDN低阻抗設計。

發表于：2/28/2023

幅度校準功能的低附加相移數控衰減器[其他][其他]

提出了一種可用于Ka 波段相控陣系統的高精度低附加相移五位數控衰減器（Digital Controlled Attenuator，DCA）。該DCA采用了嵌入式開關的T型、簡化T型和Π型三種衰減結構設計基本衰減單元，實現了15.5 dB的衰減動態范圍和0.5 dB的最小衰減步進。幅度校準技術被用于信號通路中，可有效降低由工藝波動引起的衰減幅度誤差增大問題，增強了電路設計的魯棒性。同時，在T型和Π型衰減結構中采用電容補償技術提高其高頻衰減性能，實現低附加相移?；?5 nm CMOS工藝，對所提出的DCA進行了優化仿真、流片與測試驗證。芯片核心尺寸為500 µm×150 µm。測試結果表明：在25～35 GHz頻帶范圍內，參考態插入損耗為6.54～8.6 dB，32衰減態對應的輸入/輸出回波損耗優于-15 dB，幅度誤差RMS和相位誤差RMS分別為0.12～0.26 dB和1.02°～2.07°。

發表于：2/28/2023

多態性PCIE橋擴展芯片的設計和硅后驗證[模擬設計][其他]

作為主流的總線協議，PCIE（Peripheral Component Interconnect Express）總線的應用場景越來越豐富，連接的外圍設備也越來越多。而無論桌面還是嵌入式的通用處理器上，PCIE控制器數量有限，同時很多PCIE橋芯片的功能也很局限。為此設計出一款具備多態性的PCIE擴展橋芯片來擴展處理器PCIE處理能力。該芯片的多通路、高通量、多態性的屬性有效彌補了傳統處理器PCIE能力不足的缺點。方案通過硅后驗證方法，確定了芯片的可行性和穩定性，方案也為后續具備更多通路和屬性的PCIE擴展芯片提供了設計思路。

發表于：2/28/2023

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