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AMD慶祝賽靈思成立40周年

AMD慶祝賽靈思成立40周年

40 年前，賽靈思（Xilinx）推出了一種革命性的設(shè)備，讓工程師可以在辦公桌上使用邏輯編程。賽靈思開發(fā)的現(xiàn)場(chǎng)可編程門陣列（FPGA）使工程師能夠?qū)⒕哂凶远x邏輯的比特流下載到臺(tái)式編程器中立即運(yùn)行，而無需等待數(shù)周才能從晶圓廠返回芯片。如果出現(xiàn)錯(cuò)誤或問題，設(shè)備可以在那里重新編程。

FPGA實(shí)現(xiàn)UART和MCU一體化設(shè)計(jì)

在當(dāng)今電子設(shè)計(jì)領(lǐng)域，尤其是電子核心器件和設(shè)計(jì)軟件落后的情況下，應(yīng)用傳統(tǒng)的電子設(shè)計(jì)方法既浪費(fèi)時(shí)間，且成本可能太高，甚至有時(shí)候性能也不能滿足要求，通過FPGA技術(shù)進(jìn)行設(shè)計(jì)可以使性能得到大大改觀。本文就是利用FPGA技術(shù)實(shí)現(xiàn)的一個(gè)計(jì)算機(jī)外圍I／O設(shè)備和一個(gè)簡(jiǎn)單的微控制器。隨著FPGA技術(shù)的進(jìn)一步成熟和發(fā)展，它的性能和靈活性會(huì)更加出色，將來完全有可能將一臺(tái)計(jì)算機(jī)系統(tǒng)在其內(nèi)部，并搭配外圍接口電路，而且性能會(huì)更加突出。隨著計(jì)算機(jī)技術(shù)應(yīng)用的擴(kuò)大，尤其是嵌入式計(jì)算機(jī)的廣泛使用，應(yīng)用FPGA技術(shù)進(jìn)行現(xiàn)代數(shù)字系統(tǒng)的設(shè)計(jì)，會(huì)使系統(tǒng)更加緊致，功能更加完善，功耗更加降低，性能更加穩(wěn)定。因此，應(yīng)用FPGA進(jìn)行電子設(shè)計(jì)勢(shì)在必行。

發(fā)表于：4/7/2011

基于CPLD/FPGA的半整數(shù)分頻器的設(shè)計(jì)實(shí)例

在數(shù)字邏輯電路設(shè)計(jì)中，分頻器是一種基本電路。通常用來對(duì)某個(gè)給定頻率進(jìn)行分頻，以得到所需的頻率。整數(shù)分頻器的實(shí)現(xiàn)非常簡(jiǎn)單，可采用標(biāo)準(zhǔn)的計(jì)數(shù)器，也可以采用可編程邏輯器件設(shè)計(jì)實(shí)現(xiàn)。

發(fā)表于：4/7/2011

一種新型高速數(shù)據(jù)采集系統(tǒng)的設(shè)計(jì)與實(shí)現(xiàn)

介紹了一種基于USB2.0接口的高速數(shù)據(jù)采集系統(tǒng)的設(shè)計(jì)。該采集系統(tǒng)能夠?qū)⒗走_(dá)接收機(jī)送來的信號(hào)進(jìn)行高速的采集，然后通過USB接口，將采集到的數(shù)據(jù)送到計(jì)算機(jī)，經(jīng)由上層軟件對(duì)數(shù)據(jù)進(jìn)行處理分析。

發(fā)表于：4/7/2011

基于FPGA的煙支檢測(cè)系統(tǒng)的設(shè)計(jì)

為了實(shí)現(xiàn)煙支剔除的自動(dòng)化程度，減少人為干預(yù)量和提高剔除精度，文中給出了采用FPGA硬件編程方法將數(shù)據(jù)采集部件采集到的煙支數(shù)據(jù)經(jīng)A／D轉(zhuǎn)換后送入FPGA，然后根據(jù)一定的判決算法輸出控制信號(hào)，以用于控制剔除閥動(dòng)作，同時(shí)將數(shù)據(jù)通過計(jì)算機(jī)串口讀入上位機(jī)，以此實(shí)現(xiàn)機(jī)械剔除控制和顯示實(shí)現(xiàn)方法。

發(fā)表于：4/7/2011

基于FPGA的激光筆輔助教學(xué)系統(tǒng)設(shè)計(jì)與實(shí)現(xiàn)

摘要：為了實(shí)現(xiàn)激光筆與大屏幕的互動(dòng)，基于常用的OV9650攝像頭模塊和315MHz無線收發(fā)模塊，采用了一種FPGA架構(gòu)實(shí)現(xiàn)激光筆與大屏幕互動(dòng)的設(shè)計(jì)方案。OV9650攝像頭模塊的采集信號(hào)由FPGA進(jìn)行緩存和處理，由它計(jì)算出激光點(diǎn)

發(fā)表于：4/5/2011

基于Virtex5的Gbps無線通信基站設(shè)計(jì)

LTE、IMT-Advanced等未來移動(dòng)通信系統(tǒng)要支持大量的寬帶用戶和極高的空中接口速率，使用MIMO、OFDM、LDPC等復(fù)雜的通信信號(hào)處理算法，具有動(dòng)態(tài)可重配置、計(jì)算資源動(dòng)態(tài)調(diào)度能功能，對(duì)基站的計(jì)算處理和互連提出了極高的要求。以單平臺(tái)多系列的Virtex-5系列FPGA為核心設(shè)計(jì)的Gpbs無線通信基站，采用基于交換的互連和分組的數(shù)據(jù)傳輸機(jī)制，可以驗(yàn)證各種未來無線通信所使用的算法與技術(shù)，實(shí)現(xiàn)Gbps的無線傳輸通信。

發(fā)表于：4/4/2011

基于FPGA的8PSK軟解調(diào)的研究與實(shí)現(xiàn)

由于LLR 算法具有較高的運(yùn)算復(fù)雜度，不易于硬件實(shí)現(xiàn)，而經(jīng)過簡(jiǎn)化的MAX 算法由于避免了指數(shù)和對(duì)數(shù)運(yùn)算，大大降低運(yùn)算復(fù)雜度，只需進(jìn)行加減法和少數(shù)乘法運(yùn)算，適合于硬件實(shí)現(xiàn)。該設(shè)計(jì)通過MATLAB 與VHDL 仿真對(duì)照，驗(yàn)證了MAX 軟解調(diào)算法硬件設(shè)計(jì)的準(zhǔn)確性，同時(shí)將該模塊與LDPC 譯碼模塊級(jí)聯(lián)，在具體的FPGA 芯片上運(yùn)行，利用片上分析儀Chipscope 進(jìn)一步驗(yàn)證設(shè)計(jì)的可行性。

發(fā)表于：4/4/2011

基于FPGA的VGA顯示控制器的設(shè)計(jì)

該顯示控制器是基于Xilinx公司的Spartan-IIE系列FPGA XC2S300E-6-PQ208C設(shè)計(jì)實(shí)現(xiàn)的。此FPGA邏輯資源豐富，其內(nèi)有30萬個(gè)系統(tǒng)門，6912個(gè)邏輯單元(LC)，1536個(gè)可配置邏輯快(CLB)，64Kbit的塊RAM，146個(gè)可用的I/O口，4個(gè)數(shù)字延遲鎖相環(huán)(DLL)。塊RAM可實(shí)現(xiàn)大量數(shù)據(jù)的內(nèi)部存儲(chǔ)，延遲鎖相環(huán)可對(duì)時(shí)鐘進(jìn)行管理，可自動(dòng)調(diào)整并消除輸入時(shí)鐘與FPGA內(nèi)部時(shí)鐘之間的相位偏移，同時(shí)還可實(shí)現(xiàn)對(duì)時(shí)鐘的分頻、倍頻和移相。用于幀緩存的兩個(gè)SDRAM 的型號(hào)為HY57V281620HCST，此SDRAM 為Hynix公司生產(chǎn)的高速存儲(chǔ)器，其內(nèi)有四個(gè)Bank，每個(gè)Bank的存儲(chǔ)空間為2M×16bit，可應(yīng)用于需存儲(chǔ)大量數(shù)據(jù)的場(chǎng)合。

發(fā)表于：4/4/2011

安森美半導(dǎo)體180 nm工藝技術(shù)嵌入Sidense的1T-OTP存儲(chǔ)器

領(lǐng)先的邏輯非易失性存儲(chǔ)器(LNVM)一次性可編程(OTP)存儲(chǔ)器知識(shí)產(chǎn)權(quán)(IP)內(nèi)核開發(fā)商Sidense與應(yīng)用于高能效電子產(chǎn)品的首要高性能硅方案供應(yīng)商(ON Semiconductor，美國納斯達(dá)克上市代號(hào)：ONNN)宣布，Sidence已將其180納米(nm) OTP存儲(chǔ)器SLP產(chǎn)品線移配到安森美半導(dǎo)體的180 nm數(shù)字及混合信號(hào)技術(shù)平臺(tái)ONC18。

發(fā)表于：4/2/2011

FPGA為你免除微控制器停產(chǎn)的后顧之憂

汽車制造商收到了這樣一張通知，被告知投資多年開發(fā)的，原本計(jì)劃還將生產(chǎn)10年的微控制器將要停產(chǎn)，而自己還正在使用這款器件，沒有什么比這再糟糕的事了。在過去幾年里，半導(dǎo)體供應(yīng)商在整合和削減產(chǎn)品線時(shí)，有幾款曾經(jīng)流行一時(shí)的微控制器和微處理器已被要求停產(chǎn)。

發(fā)表于：4/1/2011

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