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使用有安全保障的閃存存儲構建安全的汽車系統

使用有安全保障的閃存存儲構建安全的汽車系統

在現代汽車嵌入式系統中，高度安全的數據存儲是必不可少的，尤其是在面對日益高明的網絡攻擊時。本文將介紹設計師正確使用閃存的步驟。

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一種基于TMS320C6A8168的FPGA動態配置方法[嵌入式技術][通信網絡]

針對基帶處理系統中FPGA傳統上電配置中存在的速度和靈活性等問題，提出一種基于TMS320C6A8168 的SD卡和網口動態加載FPGA配置文件的方案。該方案以含有4片FPGA和1片C6A8168 ARM處理器所組成的嵌入式系統作為平臺，通過修改U-boot中的代碼使得基帶系統上電運行U-boot時能夠選擇性地加載PC中FPGA的配置文件，從而使FPGA完成相應的物理層算法及硬件加速。有效實現了對FPGA的配置，提高了FPGA系統配置的靈活性，在基帶處理系統中有很好的應用前景。

發表于：11/10/2016

基于SystemVerilog語言的像素cache驗證平臺的實現[可編程邏輯][信息安全]

以SystemVerilog為基礎，對自主研發的GPU“螢火蟲2號”中像素cache部分搭建可重用的驗證平臺。該平臺可以自動完成整個驗證過程，并將驗證結果打印到Linux終端和文件當中，方便程序員檢查驗證結果。實驗結果表明，該驗證平臺對像素cache的功能驗證覆蓋率可以達到100%，并且具有良好的可重用性，能夠全面、正確地完成RTL級功能驗證，有效地提高了驗證的效率和質量。

發表于：11/10/2016

一種改善LTE應用功率放大器性能的設計[微波|射頻][通信網絡]

針對LTE應用的射頻功率放大器，提出了一種結構簡單的改善功率放大器性能的方法，并應用該方法設計了一個基于InGaP/GaAs HBT工藝的兩級F類功率放大器。該功率放大器采用了三階交調失真消除技術、級間諧波抑制網絡和帶溫度補償特性的有源偏置電路以達到高線性度。此外，輸出采用F類功率放大器諧波理論以獲得高效率。該功放在工作電壓為3.4 V，頻率2.35 GHz處，分別使用連續波信號和10 MHz LTE調制信號輸入測得：增益為27.5 dB，1 dB壓縮點為30 dBm，最高效率點達到46%；平均輸出功率為28 dBm時，無線接入鄰道泄漏率為-38.4 dBc，功率附加效率為38%。

發表于：11/10/2016

基于DSP和FPGA的衛星信號模擬器設計與實現[嵌入式技術][航空航天]

為給衛星導航接收機的測試提供高穩定度、高精度、可復現的衛星信號，設計了一款衛星信號模擬器。該系統以DSP+FPGA作為核心芯片，并集成了射頻上變頻電路、高速D/A轉換電路、Flash芯片和SDRAM芯片。系統可以實現GPS L1信號和BDS B1I、B2I、B3雙模多頻點衛星信號的模擬。利用商業接收機對硬件平臺生成的衛星導航信號進行測試，定位結果驗證了衛星信號模擬器設計的正確性，表明該系統達到了預期設計要求。

發表于：11/10/2016

基于FPGA的XFA約束重復檢測匹配[可編程邏輯][數據中心]

針對目前正則表達式匹配中約束重復問題所帶來的空間消耗爆炸以及失配等問題，基于FPGA設計了一種硬件約束重復檢測匹配模塊，該模塊與基于并聯ROM的XFA匹配模塊相結合，可以快速實現約束重復的檢測和匹配。通過定義約束重復參數存儲器，計數模塊僅消耗少量的硬件資源即可實現約束重復的檢測匹配。實驗中計數模塊可實現Gbps的吞吐量，同時使正則表示式規則存儲空間壓縮50%以上。

發表于：11/9/2016

帶工藝修調的低溫漂片內振蕩器設計[模擬設計][工業自動化]

針對片內CMOS振蕩器頻率穩定性不高的問題，提出了一種對溫度和工藝的補償方案。基準電壓在正溫度電阻上產生一路負溫度系數的電流，將其與帶隙基準產生的PTAT電流進行疊加得到零溫度系數的電流對電容充電；采用數字修調網絡對電容進行修調，振蕩器頻率的工藝漂移被顯著降低。仿真結果表明：典型工作條件下，振蕩器中心頻率為1 MHz，占空比為50%；當溫度在-40 ℃～125 ℃范圍內變化時，振蕩器輸出頻率漂移僅為0.8%；對電容進行修調后，在三種不同的工藝角下，輸出頻率相對誤差僅為1.23%。振蕩器對溫度和工藝偏差不敏感，表現出良好的穩定性。

發表于：11/9/2016

基于FPGA的DSC高速譯碼器設計及實現[可編程邏輯][數據中心]

采用易于FPGA實現的歸一化最小和算法，通過選取合適的歸一化因子，將乘法轉化成移位和加法運算。在高斯白噪聲信道下，仿真該譯碼算法得出最佳的譯碼迭代次數，并結合Xilinx XC7VX485T資源確定量化位數。然后基于該算法和這3個參數設計了一種全新的、高速部分并行的DSC譯碼器。該譯碼器最大限度地實現了譯碼效率、譯碼復雜度、FPGA資源利用率之間的平衡，并在Xilinx XC7VX485T芯片上實現了該譯碼器，其吞吐率可達197 Mb/s。

發表于：11/9/2016

AD9957在射頻數字化短波發射機中的應用和仿真分析[微波|射頻][航空航天]

首先簡要介紹了射頻數字化短波發射機的基本原理以及AD9957芯片的主要功能，然后提出了一種利用AD9957芯片來實現射頻數字化短波發射機內部數字上變頻模塊和數/模轉換模塊的方案，使用System View軟件對AD9957在短波發射機中的應用進行仿真分析，最后給出了短波發射機中數字化部分的完整仿真電路圖。

發表于：11/9/2016

納米器件的散粒噪聲檢測方法研究[嵌入式技術][工業自動化]

針對納米器件散粒噪聲信號去噪方法的不足，利用散粒噪聲信號在不同狀態下的方差特性，提出了一種改進的經驗模態分解算法(EMD)。該算法根據信號固有模態函數(IMFs)方差最大值與對應層數的關系自適應地選擇需要處理的IMF層數，并與傳統平均算法相結合提取了散粒噪聲信號。實驗結果表明：在不同程度(≥-3.92 dB)低頻噪聲環境下，與傳統的EMD硬性去噪等方法比較可知，其信噪比提高了5.4 dB～7.0 dB，均方誤差降低了36%以上，該方法有效地去除了低頻噪聲，提高了散粒噪聲檢測的有效性。

發表于：11/9/2016

基于OLS碼的檢錯糾錯抗輻射加固設計[嵌入式技術][數據中心]

由輻射粒子引起的多單元翻轉（MCUs）已經成為了影響存儲器可靠性的一個主要問題。而存儲器抗MCUs的加固方法一般是使用可以糾正多個錯誤的錯誤糾正碼（ECCs）。使用了正交拉丁方（OLS）碼的故障容錯系統被構造用以糾正存儲器中的多個錯誤。OLS碼是一類一步大數邏輯可譯（OS-MLD）碼，可以使用非常簡單的大數邏輯電路來進行譯碼。由Verilog硬件描述語言實現設計，并且使用ModelSim進行了功能驗證。

發表于：11/8/2016

基于軟硬件協同技術的AHB-PCI測試平臺[嵌入式技術][汽車電子]

針對AHB-PCI的橋接電路，搭建了一個測試其功能的平臺。該平臺主要由軟件和硬件協同完成。硬件部分實現了兩個符合AHB標準的RAM，一個作為主機，能夠請求總線；另一個作為從機，可以接收數據。軟件方面通過驅動程序對PCI部分進行相應配置和讀寫。通過實際測試比較，使用該方法搭建的平臺比在modelsim上的仿真驗證平臺在正確性驗證上更有保障。

發表于：11/8/2016

納米級MOSFET襯底電流的偏置依賴性建模[模擬設計][汽車電子]

襯底電流是納米級MOSFET電學性質分析的重要基礎，也是集成電路設計的先決條件。建立精確的襯底電流模型是分析MOSFET器件及電路可靠性和進行電路設計所必需的。基于熱載流子效應建立了一個常規結構納米級MOSFET襯底電流的解析模型，并將模型的仿真結果與實驗結果相比較，驗證了模型的準確性。同時對襯底電流與溝道長度和偏置電壓的關系進行了分析研究，結果表明，襯底電流具有顯著的溝道長度與偏置依賴性。

發表于：11/7/2016

面向能量收集的電源技術綜述[電源技術][汽車電子]

電源技術是能量收集技術的重要核心之一，它的任何突破性成果都將促使能量收集技術發生基礎性的變革。著重介紹了面向能量收集的電源技術的發展現狀，從電力電子電路與集成、電能管理控制方法與實現、多源能量收集管理系統整合與優化這三大研究領域分支展開論述，具體內容包括上述各研究分支的當前研究工作重點以及代表性技術方案。最后，考慮產品化需求，進一步指出今后面向能量收集的電源技術發展將繼續圍繞更低輸入電壓條件下更低功耗的電路啟動、更低功耗地實現更精確跟蹤的最大功率點（MPP）控制方法、更有效地實現多源能量收集與管理系統內部融合這三大關鍵科技難題展開。

發表于：11/7/2016

基于GJB289A總線SoC芯片的1553模塊設計與實現[嵌入式技術][航空航天]

傳統的1553模塊主要采用DIP封裝的協議處理器、計時器、收發器設計，PCB板重量大、功耗高、可靠性及維護性差，難以滿足新型武器裝備的“小、低、輕”要求。提出了一種基于自主正向的高速GJB289A總線（1~10 Mb/s）SoC芯片的1553模塊設計方案，從硬件及軟件設計上闡述了基于GJB289A總線SoC芯片的1553模塊的設計與實現，并提出了該模塊的技術優勢。該模塊是一款集成終端SoC芯片的GJB289A總線通信設備，實現了GJB289A總線中的BC、RT功能。該模塊功耗低，性能、功能穩定可靠，可移植性強，集成度高，具有較高的成熟度，滿足機載航空電子系統總線設計要求，已成功應用于多個項目中。

發表于：11/4/2016

小型化GJB289A數據總線協議處理SoC芯片設計[嵌入式技術][航空航天]

傳統GJB289A總線節點采用分立器件實現其相應的功能，存在器件種類多、可維護性低、體積大、功耗高等問題，本設計HKS1553BCRT芯片采用SoC技術將微處理器、協議處理器、存儲器等資源進行片上集成，可大大降低系統功耗（降低為原來的1/8），減少體積（減少為原來的1/4），減輕重量（為原來的1/6），提高系統可靠性，傳輸速率為1~10 Mb/s，滿足機載/防務領域GJB289A總線BC/RT節點設計要求。詳細闡述了HKS1553BCRT芯片架構、功能定義、工作原理和各個模塊的設計方法，通過多層次、多角度驗證，證明芯片功能性能穩定。該芯片已通過定型，成熟度高，集成度、可靠性顯著提高。

發表于：11/4/2016

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