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設計應用

基于FPGA+DSP彈載SAR信號處理系統設計

基于FPGA+DSP彈載SAR信號處理系統設計[可編程邏輯][航空航天]

針對彈載SAR信號處理系統數據量大、信號處理實時性較難實現的問題，基于 FPGA+DSP協同處理硬件結構，設計了一種彈載SAR信號處理系統。系統采用Xilinx公司的XC2VP30和TI公司的TMS320C6416處理器分別實現回波數據的預處理和成像算法處理，所設計的系統提高了成像處理的效率，解決了并行性和速度的問題，并通過外場軌道實驗，驗證了該系統的可行性。

發表于：9/20/2019 11:42:00 AM

機器視覺在電容器外觀缺陷檢測中的應用

機器視覺在電容器外觀缺陷檢測中的應用[嵌入式技術][工業自動化]

傳統的電容器外觀缺陷檢測采用人工檢測，效率低、出錯率高、成本高。為了克服人工檢測的缺點，提高電容器生產的自動化程度，設計基于機器視覺的電容器外觀缺陷檢測系統。首先采集圖像、預處理，匹配定位到電容區域；然后采用閾值分割檢測溢膠、環氧面氣孔氣泡缺陷，采用模板匹配檢測字符、外殼破損缺陷；最后通過Blob分析，提取缺陷特征，設定閾值參數，以滿足不同標準的檢測要求。根據樣機實驗結果顯示，檢測系統大大提高了檢測效率和精度。

發表于：9/20/2019 3:19:00 AM

基于紅外地中基準的自旋穩定衛星姿態控制修正方法

基于紅外地中基準的自旋穩定衛星姿態控制修正方法[嵌入式技術][航空航天]

針對自旋穩定衛星采用紅外地中基準進行姿態控制時控制結果偏差較大的問題，首先對等傾角控制原理進行了說明，分析了太陽基準和紅外地中基準在姿態控制時的主要區別，并分析了紅外地中基準控制偏差較大的主要原因，提出了采用執行角補償修正的方法。經仿真驗證，通過執行角修正,有效提高了控制精度。

發表于：9/19/2019 11:47:00 AM

電容式位移傳感器的非線性擬合比較

電容式位移傳感器的非線性擬合比較[嵌入式技術][其他]

針對控制棒落棒時棒位指示傳感器的電容和位移關系，在水平位置下，在4種不同的工況下將控制棒數據進行標定，對標定得到的電容值取最大值和最小值的二分之一作為擬合值，分別采用三次樣條插值、最小二乘法、BP神經網絡的方法對數據進行擬合，然后使用4種工況下得到的原始數據進行插值觀察誤差并做殘差分析。MATLAB擬合結果表明，三次樣條插值具有良好的效果。

發表于：9/19/2019 11:32:00 AM

一種混合的單圖像去運動模糊方法

一種混合的單圖像去運動模糊方法[嵌入式技術][其他]

圖像的盲恢復一直是數字圖像處理領域的難點，對運動模糊圖像的復原進行研究，提出了一種混合的單圖像去運動模糊方法。首先估計PSF，然后利用PSF和原始模糊圖像評估潛像，并對邊緣恢復、模糊核估計和反卷積進行多次迭代，采用自適應非盲反卷積方法得到高質量的去模糊圖像。最后，與維納濾波、露西-理查德森這兩種經典算法的實驗效果進行比較。實驗結果表明，本算法保持細節的能力強，去模糊效果更好。

發表于：9/18/2019 1:24:00 PM

基于Laplacian算法的水下偏振圖像復原

基于Laplacian算法的水下偏振圖像復原[嵌入式技術][工業自動化]

為了解決船舶航行過程中水下圖像質量退化的問題，開展了基于偏振成像的圖像對比度提高技術和圖像增強算法的研究。該技術中提出了基于偏振信息將不同角度的融合圖像分解為多尺度的金字塔圖像序列，通過高斯卷積和Laplacian Pyramid算法進行圖像融合，結合權重融合系數算法實現對偏振圖像的細節特征增強處理；并與小波變換圖像融合算法進行對比，可以得出該算法明顯改善了水下圖像的SNR值和SSIM值。實驗表明，該水下偏振系統在衰減系數為2.1的海水環境中，水下成像距離達到6 m，能清晰識別水中物體及其特征識別，且系統運行穩定。

發表于：9/18/2019 5:46:00 AM

基于指紋量化的改進加權質心定位算法

基于指紋量化的改進加權質心定位算法[通信與網絡][通信網絡]

針對室內人員定位信號存在干擾大、定位精度低的問題，提出一種基于指紋量化的改進加權質心定位算法。該算法在ZigBee通信環境下采集實際測量值建立指紋數據庫，在量化域內根據未知節點接收到的RSSI值進行量化，獲得量化距離及量化RSSI值，將量化距離以及產生的量化誤差作為權值參數，進一步利用改進的交集三角形加權質心算法對未知節點進行定位。實驗結果表明，該算法可以有效避免因信號衰減嚴重而造成的理論誤差問題，提高了定位精度。

發表于：9/17/2019 1:36:00 PM

基于YunSDR-Y450的BRNs網絡路由協議實現

基于YunSDR-Y450的BRNs網絡路由協議實現[通信與網絡][通信網絡]

阻繼網絡(Barrage Relay Networks，BRNs)是針對戰術互聯網提出的一種多跳自組織的新型網絡路由協議。該協議利用無線網絡的廣播特性實現路由與數據傳輸，具有低開銷、低時延和高魯棒性的特點，可適應復雜多變的網絡環境。基于YunSDR-Y450射頻通信硬件完成了路由協議開發與測試。該實現方案以時分多址技術與自主協同技術為前提，通過傳輸路由控制消息（請求與回復）完成受控攔截區域的建立。節點對路由控制消息中的關鍵值進行處理，再判定本地在受控攔截區域中的傳輸屬性，從而完成路由過程。消息在受控攔截區域中可以進行快速傳輸，其時延主要依賴物理傳輸速度。

發表于：9/17/2019 11:10:00 AM

旋轉環境下基于FPGA的多通道數據采集系統設計

旋轉環境下基于FPGA的多通道數據采集系統設計[可編程邏輯][工業自動化]

為了滿足某大型旋轉機械設備在監測過程中實時性高精度多通道的采集需求，提出了一種基于FPGA的多通道振動信號采集檢測系統的設計方案。系統采用主/從式FPGA架構，在強噪聲環境下實現了采樣頻率為100 kHz的128通道并行實時數據采集功能。然后通過設計一種參數可調的隨機共振信號檢測系統，提高了信號信噪比，增強了系統在旋轉環境下檢測的準確性。經測試驗證，該系統具有良好的實時性、穩定性和有效性。

發表于：9/16/2019 9:25:00 AM

基于SPCB的處理器直連低延時PCS的設計實現

基于SPCB的處理器直連低延時PCS的設計實現[通信與網絡][其他]

SERDES(串行解串)技術因其傳輸速率高、抗干擾能力強等優點已成為主流的高速接口物理層規范。但由于上層PCS（物理編碼子層）需設置彈性緩沖、編解碼等功能，導致系統傳輸延時較高，無法直接應用于處理器直連等延遲敏感應用領域。介紹了一種基于同源相位補償緩沖(Synchronous Phase Compensation Buffer，SPCB)的PCS架構的設計實現，可應用于延時敏感的SERDES接口傳輸系統。該架構具有高吞吐率和超低延時的特點，通過定制的SPCB，單通道32 Gb/s時，發送與接收通路傳輸延時為10 ns左右，約為業界典型PCS方案的一半，達到Intel與AMD并行CPU直連接口（QPI和HT）的延時水平。該PCS架構可通過28 nm/16 nm/7 nm工藝物理實現，已應用于多款國產處理器直連接口。

發表于：9/15/2019 5:35:00 PM

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