| 基于多比特帶通△∑調制器的射頻數字功放 | |
| 所屬分類：技術論文 | |
| 上傳者：aet | |
| 文檔大小：525 K | |
| 標簽： 多比特帶通 多電平開關功放 數字功放 | |
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| 文檔介紹：為提高射頻功放的線性和效率，提出了一種基于多比特帶通△∑調制器（BPDSM）的射頻數字功放結構并給出了BPDSM的設計方法。針對調制器CRFB實現結構中關鍵路徑過長的問題，利用重定時、流水線和超前計算等技術對實現結構進行了改進，將BPDSM的實現速率提高至200 MHz。提出了多電平開關功放的電路結構，將多個具有獨立電源的開關功放單元進行串聯，實現了對BPDSM輸出多比特脈沖信號的高效開關放大。最后,利用FPGA器件及分立元件實現了頻率為30 MHz的數字功放，輸出功率為10 W時效率達到60%。 | |
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