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AMD慶祝賽靈思成立40周年

AMD慶祝賽靈思成立40周年

40 年前，賽靈思（Xilinx）推出了一種革命性的設(shè)備，讓工程師可以在辦公桌上使用邏輯編程。賽靈思開發(fā)的現(xiàn)場可編程門陣列（FPGA）使工程師能夠?qū)⒕哂凶远x邏輯的比特流下載到臺式編程器中立即運行，而無需等待數(shù)周才能從晶圓廠返回芯片。如果出現(xiàn)錯誤或問題，設(shè)備可以在那里重新編程。

名博·使用Verilog設(shè)計的ModelSim入門指南

本文的部分章節(jié)，來源于作者翻譯的Terasic DE2-115的英文入門文檔。采用軟件平臺：ModelSim-Altera 6.5e (Quartus II 10.0) Starter Edition。

發(fā)表于：9/6/2010

28nm 7系列FPGA助力賽靈思挺進(jìn)百億市場

6月22日，賽靈思公司質(zhì)量管理和新產(chǎn)品導(dǎo)入全球高級副總裁、亞太區(qū)執(zhí)行總裁湯立人先生和亞太區(qū)市場及應(yīng)用總監(jiān)張宇清先生向京城媒體宣布了賽靈思又一里程碑式的發(fā)展步驟——創(chuàng)建一套新的產(chǎn)品品牌。賽靈思公司在其 Virtex FPGA系列的基礎(chǔ)上，推出了通用Kintex-7系列FPGA和低功耗/低成本Artix-7系列FPGA。這兩個新系列產(chǎn)品與Virtex-7組成了賽靈思全新的7系列FPGA產(chǎn)品。7系列FPGA產(chǎn)品采用賽靈思的28 nm 平臺，將功耗銳減 50%，容量高達(dá) 200萬個邏輯單元。

發(fā)表于：9/3/2010

基于FPGA的仿真系統(tǒng)數(shù)據(jù)采集控制器IP核設(shè)計

介紹了在大型工業(yè)模擬仿真系統(tǒng)中，利用FPGA和軟IP核實現(xiàn)數(shù)據(jù)采集及收發(fā)控制的方案，并對其進(jìn)行設(shè)計實現(xiàn)。重點闡述了在發(fā)送指令和采集接收兩種數(shù)據(jù)流模式下，該IP核的控制處理邏輯及工作狀態(tài)機的設(shè)計及實現(xiàn)。同時，設(shè)計仿真測試對其進(jìn)行驗證。經(jīng)測試驗證，該IP核能實現(xiàn)對前端模擬仿真設(shè)備狀態(tài)實時采集并控制的功能，達(dá)到了設(shè)計目的。

發(fā)表于：9/2/2010

基于CPLD的16位高精度數(shù)字電壓表設(shè)計

傳統(tǒng)的數(shù)字電壓表多以單片機為控制核心，采用CPLD進(jìn)行產(chǎn)品開發(fā)，可以靈活地進(jìn)行模塊配置，大大縮短了開發(fā)周期，也有利于數(shù)字電壓表向小型化、集成化的方向發(fā)展。

發(fā)表于：9/1/2010

基于FPGA 的多時鐘片上網(wǎng)絡(luò)設(shè)計

隨著技術(shù)的發(fā)展和進(jìn)步，基于FPGA 的片上網(wǎng)絡(luò)研究成為相關(guān)領(lǐng)域研究熱點。大多數(shù)基于FPGA 的片上網(wǎng)絡(luò)設(shè)計都是在單一時鐘下進(jìn)行，整個網(wǎng)絡(luò)的性能將會因統(tǒng)一時鐘的限制而降低。介紹基于Xilinx 公司的Virtex-4 平臺下的一個多時鐘片上網(wǎng)絡(luò)的設(shè)計，以及比較片上網(wǎng)絡(luò)在單一時鐘和多時鐘下的性能。

發(fā)表于：9/1/2010

中興通訊衛(wèi)亞東:FPGA在3G通信領(lǐng)域的應(yīng)用

由工業(yè)和信息化部指導(dǎo)，西安市科學(xué)技術(shù)局、西安市集成電路產(chǎn)業(yè)發(fā)展中心和中國電子報社主辦，陜西省半導(dǎo)體行業(yè)協(xié)會、西安軟件園發(fā)展中心和西安地區(qū)科技交流中心協(xié)辦的2010年(第二屆)中國FPGA產(chǎn)業(yè)發(fā)展論壇于8月31日在西安市隆重舉行。本次論壇的主題是可編程技術(shù)加速中國

發(fā)表于：8/31/2010

基于FPGA的二-十進(jìn)制轉(zhuǎn)碼器設(shè)計

針對二進(jìn)制轉(zhuǎn)十進(jìn)制(BCD)轉(zhuǎn)碼器的FPGA實現(xiàn)目標(biāo)，提出了一種高效、易于重構(gòu)的轉(zhuǎn)碼器設(shè)計方案。并在FPGA開發(fā)板上成功地實現(xiàn)了該設(shè)計，驗證結(jié)果表明，與使用中規(guī)模集成電路IP核(SN74185A)實現(xiàn)的7 bit、10 bit和12 bit的轉(zhuǎn)碼器相比，本設(shè)計可以分別節(jié)約28.5%、47.6%和49.6%的硬件實現(xiàn)代價(邏輯單元LEs)；同時，電路的路徑延遲也分別減少了0.7 ns、2.1 ns和8.9 ns．

發(fā)表于：8/31/2010

基于FPGA+DSP+ARM的數(shù)據(jù)傳送總線變換器設(shè)計

介紹了基于FPGA+DSP+ARM的數(shù)據(jù)傳送總線變換器的整體設(shè)計及ARM、DSP和FPGA的器件選型，詳細(xì)描述了ARM與DSP、DSP與FPGA的接口電路設(shè)計，給出了系統(tǒng)軟件結(jié)構(gòu)設(shè)計,詳細(xì)描述了HPI驅(qū)動程序的實現(xiàn)過程。

發(fā)表于：8/31/2010

FPGA及動態(tài)可重構(gòu)技術(shù)在軟件無線電中的應(yīng)用

介紹了將現(xiàn)場可編程門陣列（FPGA）專用硬件處理器集成到軟件通信體系結(jié)構(gòu)（SCA）中的機制，實現(xiàn)了動態(tài)部分可重構(gòu)技術(shù)在軟件無線電（SDR）硬件平臺中的應(yīng)用，有效地縮短系統(tǒng)開發(fā)周期，提高了硬件資源的利用率。

發(fā)表于：8/31/2010

Spartan-3 FPGA實現(xiàn)的DSP嵌入系統(tǒng)及其在平板顯示器中的應(yīng)用

Spartan-3 FPGA實現(xiàn)的DSP嵌入系統(tǒng)及其在在平板顯示器中的應(yīng)用,前言用FPGA實現(xiàn)的嵌入式系統(tǒng)，均是在更大的芯片中嵌入的重復(fù)完成特定功能的計算系統(tǒng)，雖則是隱含嵌入，但實際上在各種常用的芯片中能夠找到這些嵌入式系統(tǒng)。例如，消費類電子產(chǎn)品中的手機、尋呼機、數(shù)字相機、攝像機

發(fā)表于：8/30/2010

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