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AMD慶祝賽靈思成立40周年

AMD慶祝賽靈思成立40周年

40 年前，賽靈思（Xilinx）推出了一種革命性的設備，讓工程師可以在辦公桌上使用邏輯編程。賽靈思開發(fā)的現(xiàn)場可編程門陣列（FPGA）使工程師能夠將具有自定義邏輯的比特流下載到臺式編程器中立即運行，而無需等待數(shù)周才能從晶圓廠返回芯片。如果出現(xiàn)錯誤或問題，設備可以在那里重新編程。

基于網口傳輸?shù)腖ED同步屏控制系統(tǒng)及其FPGA實現(xiàn)

LED全彩同步控制系統(tǒng)具有高性能實時顯示、節(jié)能、環(huán)保等優(yōu)點，成為現(xiàn)代信息發(fā)布的重要媒體。本設計改變傳統(tǒng)設計中采集顯卡VESA信號接口、使用并行多根總線傳送數(shù)據(jù)的方式，改用采集DVI接口、通過網口傳輸數(shù)據(jù)，既節(jié)省成本也提高了傳輸效率和傳輸質量。另外，該設計還采用一系列新技術，例如使用高集成度FPGA作為主控制模塊、使用大容量SDRAM代替高成本的等容量SRAM、采用信號包復用技術同步傳送顯示數(shù)據(jù)和控制數(shù)據(jù)、采用高效率的灰度切片算法等等。LED同步屏控制系統(tǒng)具有成本低、顯示面積大、顯示穩(wěn)定、刷新率高等特點，是目前市面上非常具有競爭力的顯示控制方案。

發(fā)表于：7/14/2011

基于FPGA的雙口RAM與PCI9O52接口設計

本設計采用了可編程邏輯芯片來實現(xiàn)PCI訪問雙口RAM的接口電路，該接口電路具有可改性與適用性。隨著微電子技術的發(fā)展，可編程器件的容量已經達到千萬門級，越來越多過去必須由專用芯片或器件才能完成的工作現(xiàn)在都可以通過設計軟件由FPGA來實現(xiàn)了。硬件的軟件化已經成為電子行業(yè)中不可阻擋的趨勢。

發(fā)表于：7/14/2011

三星成功流片全球第一顆20nm工藝試驗芯片

三星電子日前宣布，已經成功實現(xiàn)了20nm工藝試驗芯片的流片，這也是迄今為止業(yè)內最先進的半導體制造工藝。

發(fā)表于：7/14/2011

基于DSP+FPGA的光柵地震檢波器的信號處理

設計的光柵地震檢波器充分結合了FPGA的強大控制功能和DSP高速運算處理功能，實現(xiàn)了信號的同步采集、高倍細分和實時復現(xiàn)。減少了單一處理器的負荷，提高了系統(tǒng)的速度和穩(wěn)定性，為光柵震動信號處理提出了一個新思路。由于硬件雙口RAM接口時序復雜，成本高也會給系統(tǒng)帶來不穩(wěn)定性，因此本文在FPGA中設計了一軟RAM。對于振動信號幅值的計算則是在對整周期的莫爾條紋進行計數(shù)的同時，利用軟件細分法實時地計算出非整周期的莫爾條紋信號所代表的小數(shù)值，并實時將二者相加后乘以莫爾條紋當量(每個莫爾條紋所代表的位移量)，即可得到信號的實時振動幅值。

發(fā)表于：7/14/2011

基于Andes Core的ESL解決方案——AndESLive

近年來，IC 設計正在向電子系統(tǒng)級(ESL，electronic system level)解決方案發(fā)展。多家 EDA 公司以及 IP 供應商都推出了各自的 ESL 開發(fā)工具。晶心科技(Andes technology) 是亞洲首家完全自主知識產權 32 位嵌入式處理器 IP 核（即 Andes core）的供應商與系統(tǒng)芯片開發(fā)平臺的設計公司。晶心科技為基于 Andes core 進行 SoC 設計和開發(fā)的客戶提供了一套完整的 ESL 解決方案－AndESLive。本文將介紹 AndESLive 這套 ESL 開發(fā)工具是如何幫助客戶快速確定符合市場需求的最佳體系結構，并實現(xiàn)軟硬件并行工作以縮減開發(fā)周期的目的。

發(fā)表于：7/14/2011

中芯國際爭奪戰(zhàn)：CEO王寧國遞交辭呈

中芯國際在董事長江上舟辭世后的一個多星期以來，出現(xiàn)了有史以來最大的動蕩。伴隨著現(xiàn)任CEO王寧國在例行董事會意外落選執(zhí)行董事一職，中芯國際大股東大唐電信與其他海外股東間對控制權的爭奪浮出水面。而且，斗爭很快蔓延至公司內部，形成了以CEO王寧國和COO楊士寧為主的兩派博弈。

發(fā)表于：7/14/2011

基于循環(huán)前綴的同步算法及FPGA實現(xiàn)

　本文要討論的基于ML(最大似然估計)時頻同步算法是vande Beek等人提出來的，這是一個利用CP所攜帶的信息完成定時同步和載波同步的最大似然估計算法。它利用OFDM系統(tǒng)循環(huán)冗佘擴展的循環(huán)前綴攜帶的信息進行同步估計，避免了基于導頻碼的同步估計帶來的頻率和功率資源的浪費。

發(fā)表于：7/14/2011

基于FPGA的嵌入式以太網與Matlab通信系統(tǒng)設計

本文研究了TCP／IP通信協(xié)議在Xilinx公司FPGA上的實現(xiàn)，介紹了其軟硬件的系統(tǒng)組成及原理，通過建立一個例子加以說明和應用這個設計平臺，證明了此平臺設計可行性，并且完成了FPGA與Matlab的通信，為數(shù)據(jù)的實時顯示及實時控制提供了很好的平臺和設計方法，本設計也完成了CPU軟核設計的實現(xiàn)，其功能可根據(jù)需要進行定制，非常靈活，不但引入了軟核處理器和嵌入式操作系統(tǒng)Xilkernel，而且應用了Lw-IP_300b棧，使用大量的IP核，這樣大大降低了系統(tǒng)平臺的復雜度，縮短了開發(fā)的周期，其軟硬件部分的設計分離的設計架構，使得整個系統(tǒng)修改和重構更加方便，真正實現(xiàn)了所謂的片上系統(tǒng)。而本設計采用Matlab接收數(shù)據(jù)，并且可利用其強大的數(shù)據(jù)采集、處理、仿真、實時動態(tài)顯示的功能來更好完成數(shù)據(jù)分析研究。

發(fā)表于：7/14/2011

基于SCA規(guī)范下FPGA的硬件抽象層設計

軟件無線電(Software Radio)是指用軟件定義的、能實現(xiàn)多種功能的無線電通訊系統(tǒng)，其核心思想是構造一個具有開放性、標準化、模塊化的通用硬件平臺，以將各種功能(如工作頻段、調制解調類型

發(fā)表于：7/14/2011

基于FPGA的NAND Flash ECC校驗

本文將ECC校驗算法通過硬件編程語言VHDL在AheraQuanusⅡ7．0開發(fā)環(huán)境下進行了后仿真測試，實現(xiàn)了NANDFlash的ECC校驗功能。本程序可實現(xiàn)每256Byte數(shù)據(jù)生成3ByteECC校驗數(shù)據(jù)，且通過與原始ECC數(shù)據(jù)對比，能夠保證檢測出1bit的錯誤及其出錯位置，進一步結合對此錯誤的糾正，可應用于NANDFlash讀寫控制器的FPGA設計，實現(xiàn)對數(shù)據(jù)的ECC校驗，確保數(shù)據(jù)準備有效地傳輸。經硬件實驗結果反饋，該算法硬件適應性良好。

發(fā)表于：7/14/2011

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