《電子技術應用》
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基于FPGA的高速模數轉換器評估系統
電子技術應用
陳旻琦,鄧嵐清,楊琳韻
中科芯集成電路有限公司,江蘇 無錫 214000
摘要: 設計并驗證了一種基于現場可編程邏輯陣列(FPGA)的高速模數轉換器(ADC)評估系統。基于FPGA設計了底層邏輯,根據不同的測試指標控制ADC的信號采集和數據轉換,將模擬輸入信號轉換為數據存儲到FPGA的分布式存儲器(Block RAM)中,通過用戶數據報協議(UDP)將數據傳輸到電腦端的基于MATLAB開發的上位機,由電腦中央處理器(CPU)負責處理計算數據并輸出測試結果到用戶界面上。以一款16位、采樣率100 MS/s的ADC為例,以該評估系統對ADC的各項參數指標進行測試和分析。實驗結果表明,該系統可以實現高速、高精度ADC的測試和評估。
中圖分類號:TN709 文獻標志碼:A DOI: 10.16157/j.issn.0258-7998.234033
中文引用格式: 陳旻琦,鄧嵐清,楊琳韻. 基于FPGA的高速模數轉換器評估系統[J]. 電子技術應用,2024,50(2):96-101.
英文引用格式: Chen Minqi,Deng Lanqing,Yang Linyun. Evaluation system of high-speed anolog to digital converter based on FPGA[J]. Application of Electronic Technique,2024,50(2):96-101.
Evaluation system of high-speed anolog to digital converter based on FPGA
Chen Minqi,Deng Lanqing,Yang Linyun
China Key System & Integrated Circuit Corporation, Wuxi 214000, China
Abstract: A high speed anolog to digital converter (ADC) evaluation system based on field programmable logic array (FPGA) is designed and implemented. The logic codes are designed based on the FPGA, and the signal sampling and data transmission of ADC are controlled according to different test modes. The analog input signal is converted into digital data stored in the FPGA block RAMs, and transmitted through the user datagram protocol (UDP) to the upper computer designed in MATLAB, which processes the calculated data and output the test results to user. The parameters of a 16-bit ADC with a sampling rate of 100 MS/s are calculated and analyzed in the system. Experimental results show that this system can achieve high speed and high precision ADCs testing and evaluation.
Key words : FPGA;ADC;upper computer;MATLAB;Ethernet

引言

在通信與信息系統中,處理器對信號進行計算和處理,達成系統設計的功能。目前多數的電子計算機器基于二進制工作,以數字運算的方式對信息進行處理。在自然界中的信號是連續的模擬量,這意味著要處理模擬信號要對模擬量進行量化,轉換為電子計算機可以處理的數字信息[1]。將模擬信號轉換成數字信號的電路稱為模數轉換器(ADC)。根據奈奎斯特定律[2],ADC轉換信號的速率越快,可以轉換的信號頻率越高,因此,高速ADC廣泛應用于射頻、通信、雷達、電子戰等高頻信號場景,對高速ADC的測試和評估在工程應用中尤為重要。


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作者信息:

陳旻琦,鄧嵐清,楊琳韻

中科芯集成電路有限公司,江蘇 無錫 214000


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