基于FPGA的實(shí)時(shí)金融指數(shù)行情并行計(jì)算源代碼——第三屆OpenHW開(kāi)放源碼硬件與嵌入式大賽二等獎(jiǎng)
所屬分類(lèi)：源代碼
上傳者：chenyy
文檔大小：3102 K
標(biāo)簽： FPGA
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文檔介紹：本項(xiàng)目將圍繞期貨交易中涉及的跨期套利和跨商品套利的規(guī)則和方法，以潛在套利合約的數(shù)據(jù)分析為典型應(yīng)用場(chǎng)景，通過(guò)FPGA專(zhuān)用硬件平臺(tái)，以千兆以太網(wǎng)絡(luò)為通用的交易數(shù)據(jù)通信端口，研究交易數(shù)據(jù)的并行調(diào)度策略和計(jì)算模型，將相應(yīng)速度提升3-4個(gè)數(shù)量級(jí)，實(shí)現(xiàn)大規(guī)模實(shí)時(shí)并行數(shù)據(jù)處理。主機(jī)通過(guò)驅(qū)動(dòng)和Socket應(yīng)用程序?qū)⒔灰讛?shù)據(jù)從以太網(wǎng)口發(fā)送到目標(biāo)平臺(tái)上，經(jīng)過(guò)MAC層解析將有效的交易數(shù)據(jù)交給并行調(diào)度模塊。并行調(diào)度模塊使用AC自動(dòng)機(jī)算法搜索交易條目，然后分配給并行單元PE進(jìn)行并行計(jì)算。最后計(jì)算的結(jié)果匯總到數(shù)據(jù)緩存FIFO中，通過(guò)以太網(wǎng)模塊發(fā)送給主機(jī)顯示。
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