| 基于CPLD的FPGA快速配置電路的設(shè)計 | |
| 所屬分類：技術(shù)論文 | |
| 上傳者：aet | |
| 文檔大小：165 K | |
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| 文檔介紹：介紹了采用CPLD和Flash器件對FPGA實現(xiàn)快速并行配置，并給出了具體的硬件電路設(shè)計和關(guān)鍵模塊的內(nèi)部編程思路。 | |
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