基于Verilog的RISC MCU中斷系統(tǒng)的設(shè)計(jì)與驗(yàn)證
所屬分類：技術(shù)論文
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文檔介紹：詳細(xì)論述了4位RISC MCU中斷系統(tǒng)的Verilog設(shè)計(jì)實(shí)現(xiàn)過程。該MCU采用PIC兩級流水線結(jié)構(gòu)，含4個(gè)中斷源，2級優(yōu)先級。最后通過整體的RISC MCU IP核對其中斷系統(tǒng)進(jìn)行完整的程序測試，完成功能與時(shí)序的仿真與驗(yàn)證。
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