| DE2_實(shí)驗(yàn)練習(xí)解答—lab_3：鎖存器、觸發(fā)器和寄存器(digital_Logic)(DE2)(quartus_II) | |
| 所屬分類：解決方案 | |
| 上傳者：hbcxzcj | |
| 文檔大小：545 K | |
| 標(biāo)簽： Altera Verilog Quartus II | |
| 所需積分：0分積分不夠怎么辦？ | |
| 文檔介紹：Altera的FPGA含有可供用戶使用的觸發(fā)器電路。在Part IV演示如何使用它。這里探討如何不使用專用觸發(fā)器來創(chuàng)建存儲(chǔ)單元。圖1描述了門控鎖存器電路。可用門級(jí)電路或表達(dá)式來描述。 | |
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