| DRAM內(nèi)存模塊的設(shè)計技術(shù) | |
| 所屬分類：白皮書 | |
| 上傳者：serena | |
| 標(biāo)簽： DRAM 內(nèi)存模塊 | |
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| 文檔介紹： 第二部分：DRAM 內(nèi)存模塊的設(shè)計技術(shù)..............................................................143 第一章 SDR 和DDR 內(nèi)存的比較..........................................................................143 第二章 內(nèi)存模塊的疊層設(shè)計.............................................................................145 第三章 內(nèi)存模塊的時序要求.............................................................................149 3.1 無緩沖（Unbuffered）內(nèi)存模塊的時序分析.......................................149 3.2 帶寄存器（Registered）的內(nèi)存模塊時序分析...................................154 第四章 內(nèi)存模塊信號設(shè)計.................................................................................159 4.1 時鐘信號的設(shè)計.......................................................................................159 4.2 CS 及CKE 信號的設(shè)計..............................................................................162 4.3 地址和控制線的設(shè)計...............................................................................163 4.4 數(shù)據(jù)信號線的設(shè)計 | |
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