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AMD慶祝賽靈思成立40周年

AMD慶祝賽靈思成立40周年

40 年前，賽靈思（Xilinx）推出了一種革命性的設(shè)備，讓工程師可以在辦公桌上使用邏輯編程。賽靈思開(kāi)發(fā)的現(xiàn)場(chǎng)可編程門陣列（FPGA）使工程師能夠?qū)⒕哂凶远x邏輯的比特流下載到臺(tái)式編程器中立即運(yùn)行，而無(wú)需等待數(shù)周才能從晶圓廠返回芯片。如果出現(xiàn)錯(cuò)誤或問(wèn)題，設(shè)備可以在那里重新編程。

基于FPGA的方向?yàn)V波指紋圖像增強(qiáng)算法實(shí)現(xiàn)

設(shè)計(jì)了一種基于FPGA純硬件方式實(shí)現(xiàn)方向?yàn)V波的指紋圖像增強(qiáng)算法。采用寄存器傳輸級(jí)（RTL）硬件描述語(yǔ)言（Verilog HDL），利用時(shí)分復(fù)用和流水線處理等技術(shù)完成了方向?yàn)V波指紋圖像增強(qiáng)算法在FPGA上的實(shí)現(xiàn)。系統(tǒng)通過(guò)了Modelsim的仿真驗(yàn)證，并在Terasic公司的DE2平臺(tái)上完成了硬件測(cè)試。

發(fā)表于：8/16/2018

公布代號(hào)為Foreshadow的SGX技術(shù)缺陷，英特爾處理器還有多少漏洞未發(fā)現(xiàn)？

近日，英特爾公布了一個(gè)可能會(huì)導(dǎo)致敏感數(shù)據(jù)泄露的潛在安全漏洞，這已經(jīng)是它自今年年初以來(lái)第三次不得不披露其系統(tǒng)漏洞了。

發(fā)表于：8/15/2018

RISC-V帶給中國(guó)CPU和芯片行業(yè)發(fā)展的歷史性機(jī)遇

微處理器指令集架構(gòu)（Instruction Set Architecture，ISA）是溝通軟硬件運(yùn)算之間的橋梁，是處理器的靈魂。包括復(fù)雜指令集運(yùn)算（Complex Instruction Set Computing，CISC）、精簡(jiǎn)指令集運(yùn)算（Reduced Instruction Set Computing，RISC）、顯式并行指令集運(yùn)算（Explicitly Parallel Instruction Computing，EPIC）、超長(zhǎng)指令字指令集運(yùn)算（Very Long Instruction Word，VLIW）四類。

發(fā)表于：8/15/2018

學(xué)界 | 老論文沒(méi)有源碼？14年神經(jīng)圖靈機(jī)的復(fù)現(xiàn)被接收為大會(huì)論文

在篇篇論文都是 state-of-the-art 的年代，論文的可復(fù)現(xiàn)性與官方代碼一直受到研究者的關(guān)注，我們希望知道實(shí)際的模型性能或改進(jìn)方法到底有沒(méi)有原論文寫的那么好。

發(fā)表于：8/15/2018

創(chuàng)芯選星，為芯而戰(zhàn)

8月11日至8月12日，中國(guó)研究生創(chuàng)新實(shí)踐系列大賽主題賽事之一“華為杯”首屆中國(guó)研究生創(chuàng)“芯”大賽在廈門成功舉辦。來(lái)自全國(guó)40余所高校、148支隊(duì)伍、500余名師生通過(guò)兩天的角逐，經(jīng)過(guò)現(xiàn)場(chǎng)設(shè)計(jì)、分組答辯與公開(kāi)競(jìng)演的重重考驗(yàn)；最終，13只隊(duì)伍脫穎而出，華東師范大學(xué)、西安電子科技大學(xué)、電子科技大學(xué)的三支隊(duì)伍拔得頭籌，獲得創(chuàng)“芯”大賽的特等獎(jiǎng)；另外10支隊(duì)伍獲得大賽一等獎(jiǎng)。中國(guó)工程院院士倪光南、中國(guó)科學(xué)院院士陸建華親自上臺(tái)為特等獎(jiǎng)獲得者頒獎(jiǎng)，廣大參賽學(xué)生受到了極大的鼓舞。

發(fā)表于：8/15/2018

工業(yè)4.0下的現(xiàn)代的驅(qū)動(dòng)系統(tǒng)介紹

隨著工業(yè)4.0應(yīng)用的快速增長(zhǎng)，機(jī)器制造商們對(duì)于使用更少的人員為先進(jìn)的機(jī)器提供更短的開(kāi)發(fā)時(shí)間感到壓力。利用實(shí)時(shí)的數(shù)據(jù)為運(yùn)行決策制定提供必要信息的需求正在不斷增長(zhǎng)。與工業(yè)4.0 相關(guān)的關(guān)鍵字是連接性（在生產(chǎn)過(guò)程中所有參與者之間的連接），即使是在還沒(méi)有應(yīng)用工業(yè)4.0 的工廠里也是如此。

發(fā)表于：8/14/2018

基于FPGA的超聲波信號(hào)處理設(shè)計(jì)與實(shí)現(xiàn)

為了滿足超聲波探傷檢測(cè)的實(shí)時(shí)性需求，通過(guò)研究超聲波探傷的工作原理，提出了基于FPGA芯片的實(shí)時(shí)信號(hào)處理系統(tǒng)實(shí)現(xiàn)方案及硬件結(jié)構(gòu)設(shè)計(jì)，并根據(jù)FPGA邏輯結(jié)構(gòu)模型實(shí)現(xiàn)了軟件系統(tǒng)的模塊化設(shè)計(jì)。根據(jù)實(shí)驗(yàn)測(cè)試及統(tǒng)計(jì)數(shù)據(jù)得出，基于FPGA芯片的信號(hào)處理系統(tǒng)提高了探傷檢測(cè)的準(zhǔn)確性與穩(wěn)定性，滿足了探傷過(guò)程中B超顯示的實(shí)時(shí)性要求。

發(fā)表于：8/14/2018

基于FPGA的多通道HDLC通信系統(tǒng)設(shè)計(jì)與實(shí)現(xiàn)

為了滿足某測(cè)控平臺(tái)的設(shè)計(jì)要求，設(shè)計(jì)并實(shí)現(xiàn)了基于FPGA的六通道HDLC并行通信系統(tǒng)。該系統(tǒng)以FPGA為核心，包括FPGA、DSP、485轉(zhuǎn)換接口等部分。給出了系統(tǒng)的電路設(shè)計(jì)、關(guān)鍵模塊及軟件流程圖。測(cè)試結(jié)果表明，系統(tǒng)通訊速度為1 Mb/s，并且工作穩(wěn)定，目前該設(shè)計(jì)已經(jīng)成功應(yīng)用于某樣機(jī)中。

發(fā)表于：8/14/2018

杭州7納米芯片出爐

這幾天，杭州企業(yè)嘉楠耘智發(fā)布的全球首個(gè)成功量產(chǎn)7納米芯片的新聞持續(xù)刷屏。

發(fā)表于：8/14/2018

基于FPGA的數(shù)字三相鎖相環(huán)的優(yōu)化設(shè)計(jì)

數(shù)字三相鎖相環(huán)中含有大量乘法運(yùn)算和三角函數(shù)運(yùn)算，占用大量的硬件邏輯資源。為此，提出一種數(shù)字三相鎖相環(huán)的優(yōu)化實(shí)現(xiàn)方案，利用乘法模塊復(fù)用和CORDIC算法實(shí)現(xiàn)三角函數(shù)運(yùn)算，并用Verilog HDL硬件描述語(yǔ)言對(duì)優(yōu)化前后的算法進(jìn)行了編碼實(shí)現(xiàn)。仿真和實(shí)驗(yàn)結(jié)果表明，優(yōu)化后的數(shù)字三相鎖相環(huán)大大節(jié)省了FPGA的資源，并能快速、準(zhǔn)確地鎖定相位，具有良好的性能。

發(fā)表于：8/14/2018

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