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解決方案

ADI ADuCRF101低功耗無線數(shù)據(jù)采集解決方案[嵌入式技術][其他]

ADI公司的ADuCRF101是全集成無線數(shù)據(jù)采集系統(tǒng),集成了12位SARADC,低功耗ARM Cortex－M3處理器,862MHz－928MHz和431MHz－464MHzRF收發(fā)器以及閃存/EE存儲器,包括UART,I2C,SPI,GPIO端口和PWM在內的外設,主要用在無線傳感器,遠程醫(yī)療系統(tǒng),工業(yè)和家庭自動化,財產跟蹤,安全系統(tǒng)以及醫(yī)療保健設備等.本文介紹了ADuCRF101主要特性和優(yōu)勢,框圖,ADuCRF101迷你評估板主要特性,電路圖和PCB元件布局圖.

發(fā)表于：1/28/2014 11:11:42 AM

利用TPS2393A實現(xiàn)大電流熱插拔應用[電源技術][其他]

盡管TPS2393A只有一個相對較低的電流限制閾值，但只要穩(wěn)定狀態(tài)下的負載電流高于啟動上升期間的充電電流，它仍可適用于更多的應用。本文介紹了一種在不同工作階段（從上升到穩(wěn)定）改變電流限制的方法。

發(fā)表于：1/27/2014 11:26:03 AM

Class D 功放高次諧波過流保護分析和解決方法[模擬設計][其他]

高次諧波過流保護是一種特殊的過流、過功率現(xiàn)象。通常用戶的電路設計完全正確，常規(guī)功率測試未超過額定功率。該種保護的定位及解決較為困難。本文結合理論分析和實際經驗分析了高次諧波過流保護的原因，并提供了解決方案。

發(fā)表于：1/27/2014 9:43:57 AM

利用OPA實現(xiàn)Bass Boost案例分享[模擬設計][其他]

在模擬音箱和耳機驅動系統(tǒng)開發(fā)過程中，工程師經常希望利用驅動電路來改善低頻/高頻響應曲線. 在數(shù)字系統(tǒng)中，往往通過EQ 來進行調整，只需要很低的成本就可以滿足各種應用. 而全模擬系統(tǒng)中要實現(xiàn)EQ 功能，則需付出更多成本和努力. 本文介紹一種利用Shelving Filter 來實現(xiàn)Bass Boost 的方法，相對比較簡單、成本低廉。

發(fā)表于：1/27/2014 9:31:01 AM

智能交通電子警察無線傳輸系統(tǒng)方案[通信與網(wǎng)絡][其他]

　　方案概述：　　城市道路交通安全是城市公共交通安全的重要分支，隨著機動車輛大規(guī)模普及應用，各種與機動車有關的違法事件開始滋生蔓延，由此衍生的道路交通安全問題日益成為社會經濟發(fā)展中的一個重要制約因素。收集、統(tǒng)計和分析道路交通事故，發(fā)現(xiàn)大部分交通事故都是因為機動車違章行駛而引起，尤其在交叉路口或路段上機動車闖紅燈造成的事故所占比例最大。建設闖紅燈自動記錄系統(tǒng)，對機動車闖紅燈行為進行不間斷自動檢測和記錄，通過立法對機動車闖紅燈行為進行處罰，是遏制機動車闖紅燈行為的重要手段，進而改善城市道路交通環(huán)境，提升公眾出行安全系數(shù)。

發(fā)表于：1/26/2014 10:29:30 AM

Giga ADC 介紹及雜散分析[模擬設計][其他]

Giga ADC 是TI 推出的采樣率大于1GHz 的數(shù)據(jù)轉換產品系列，主要應用于微波通信、衛(wèi)星通信以及儀器儀表。本文介紹了Giga ADC 的主要架構以及ADC 輸出雜散的成因分析，以及優(yōu)化性能的主要措施。

發(fā)表于：1/22/2014 2:02:31 PM

LDO環(huán)路穩(wěn)定性及其對射頻頻綜相噪的影響[模擬設計][其他]

本文首先簡要地介紹了LDO 的噪聲來源及環(huán)路穩(wěn)定性對輸出噪聲的影響；其次，根據(jù)調頻理論推導出VCO 的相位噪聲與LDO 的噪聲頻譜密度的理論計算關系。在此基礎上，為了驗證LDO 噪聲對射頻頻綜輸出相噪的影響，分別采用TPS7A8101 和TPS74401 LDO 評估板給TRF3765 射頻頻綜評估板供電，對比測試這兩種情況下的TRF3765 相噪曲線；同時，為了驗證LDO 環(huán)路穩(wěn)定性對頻綜相噪的影響，針對TPS7A8101 評估板的參考電路做出部分修改，并對比測試了電路修改前后的TRF3765 輸出相噪。

發(fā)表于：1/14/2014 1:57:22 PM

HyperLink編程和性能考量[嵌入式技術][其他]

HyperLink 為兩個KeyStone 架構DSP 之間提供了一種高速，低延遲，引腳數(shù)量少的通信接口。HyperLink 的用戶手冊已經詳細的對其進行了描述。本文主要是為HyperLink 的編程提供了一些額外的補充信息。

發(fā)表于：1/14/2014 9:54:28 AM

Altera ArriaGX FPGA入門開發(fā)方案[可編程邏輯][其他]

Altera公司的ArriaGXFPGA是帶有收發(fā)器的中端FPGA系列。其收發(fā)器速率高達3.125Gbps，您可以利用它來連接支持PCIExpress,千兆以太網(wǎng),SerialRapidIO,SDI等協(xié)議的現(xiàn)有模塊和器件。具有同類最佳的信號完整性,是功耗最低的中端FPGA，適用于需要32個支持背板的6.5536Gbps收發(fā)器的應用.本文介紹了ArriaGXFPGA主要特性和架構圖,以及ArriaVGXFPGA入門開發(fā)板主要特性,框圖,電路圖,PCB元件布局圖和材料清單.

發(fā)表于：1/14/2014 8:12:54 AM

Virtex-7 FPGA Gen3 集成模塊Completion timeout機制[可編程邏輯][其他]

任何一種 split 交易協(xié)議都存在 Requesters 得不到期望的 Completion 的風險。為了允許 Requesters 使用一種標準方式從這種情況下恢復，規(guī)定了 Completion timeout機制。

發(fā)表于：1/10/2014 3:57:18 PM

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