基于FPGA的數字秒表設計與實現
所屬分類：參考設計
上傳者：aet
文檔大小：474 K
標簽： FPGA
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文檔介紹：在Quartus II軟件平臺的基礎上，基于VHDL語言及圖形輸入，采用FPGA設計了一款數字秒表，同時，給出了數字秒表系統設計方案及各個功能模塊的設計原理。通過對系統進行編譯、仿真，并下載到Cyclone系列EP2C5Q208C8器件中進行測試，結果表明，本設計能實現計時顯示、啟停、復位及計時溢出報警功能。
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