| 高斯白噪聲發(fā)生器的FPGA實(shí)現(xiàn) | |
| 所屬分類：解決方案 | |
| 上傳者：aet | |
| 文檔大小：516 K | |
| 標(biāo)簽： FPGA | |
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| 文檔介紹：分析了幾種高斯白噪聲發(fā)生器的實(shí)現(xiàn)途徑，提出了一個基于Box-Muller算法級聯(lián)中心極限定理實(shí)現(xiàn)高精度高斯白噪聲發(fā)生器的方法，在FPGA中使用HDL語言實(shí)現(xiàn)。與現(xiàn)有的實(shí)現(xiàn)方法相比，本設(shè)計(jì)速度更快、占用的資源更少，且易于FPGA實(shí)現(xiàn)，可作為一個快速實(shí)用的誤碼率測試平臺的一部分。 | |
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