一種高效二維小波分解算法的FPGA實現
所屬分類：解決方案
上傳者：coco
文檔大?。?span>259 K
標簽： FPGA
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文檔介紹：針對現有二維提升小波變換實現過程中存在的大量過程數據存儲及關鍵路徑延時較長的問題，提出一種直接進行二維變換的VLSI架構。采用ALTERA Cyclone II系列FPGA EP2C35F672C6對架構進行實現和驗證，在純計算邏輯下二維小波變換時鐘頻率可達到157.78MHz。
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