| 基于DDS+PLL的LFM探地雷達(dá)信號(hào)產(chǎn)生器設(shè)計(jì)與實(shí)現(xiàn) | |
| 所屬分類(lèi)：參考設(shè)計(jì) | |
| 上傳者：aet | |
| 文檔大小：376 K | |
| 標(biāo)簽： FPGA | |
| 所需積分：0分積分不夠怎么辦？ | |
| 文檔介紹：介紹了一種寬帶線性調(diào)頻(LFM)雷達(dá)信號(hào)產(chǎn)生的方法與實(shí)現(xiàn)，結(jié)合直接數(shù)字合成（DDS）+鎖相環(huán)（PLL）的方式，采用DDS芯片AD9852和集成鎖相芯片ADF4360-7完成了設(shè)計(jì)所需求的寬帶線性調(diào)頻信號(hào)。詳細(xì)說(shuō)明了該方案設(shè)計(jì)的構(gòu)架、各單元電路的設(shè)計(jì)與實(shí)現(xiàn)以及各芯片參數(shù)的設(shè)定情況。實(shí)測(cè)結(jié)果表明，該頻率合成器輸出功率>-4 dBm, 環(huán)路鎖定時(shí)間為 14 μs，輸出信號(hào)相位噪聲優(yōu)于-90 dBc/Hz@1 kHz，輸出信號(hào)達(dá)到了所需指標(biāo)要求。 | |
| 現(xiàn)在下載 | |
| VIP會(huì)員，AET專(zhuān)家下載不扣分；重復(fù)下載不扣分，本人上傳資源不扣分。 | |
FPGA 相關(guān)資源
- 基于FPGA的多通道橇載數(shù)據(jù)采集存儲(chǔ)系統(tǒng)設(shè)計(jì)
- 基于PXIe的CMUT多通道超聲收發(fā)板卡設(shè)計(jì)與實(shí)現(xiàn)
- 基于FPGA的多路SGMII接口以太網(wǎng)設(shè)計(jì)與測(cè)試
- 基于DDPG算法的數(shù)據(jù)傳輸研究
- 基于高性能FPGA的超高速I(mǎi)PSec安全設(shè)備設(shè)計(jì)與實(shí)現(xiàn)
- 采用SSI協(xié)議實(shí)現(xiàn)的通信控制器設(shè)計(jì)
- 基于SiP技術(shù)多核處理器微系統(tǒng)設(shè)計(jì)
- 基于FPGA的電磁繼電器在線測(cè)試系統(tǒng)設(shè)計(jì)
aet 的最新分享
- GBT15834-2011 標(biāo)點(diǎn)符號(hào)用法
- GB 15835—2011 出版物上數(shù)字用法
- 學(xué)術(shù)出版規(guī)范 表格（CYT170—2019）
- 學(xué)術(shù)出版規(guī)范插圖（CYT171—2019）
- 學(xué)術(shù)出版規(guī)范 期刊學(xué)術(shù)不端行為界定（CYT174-2019）
- GB7714-2015 信息與文獻(xiàn) 參考文獻(xiàn)著錄規(guī)則
- 破解數(shù)據(jù)要素流動(dòng)與隱私保護(hù)相沖突的局-方濱興
- 工業(yè)互聯(lián)網(wǎng)網(wǎng)絡(luò)安全實(shí)驗(yàn)室建設(shè)思路與實(shí)踐
Copyright ? 2005-2024 華北計(jì)算機(jī)系統(tǒng)工程研究所版權(quán)所有 京ICP備10017138號(hào)-2