基于片內WISHBONE總線的高速緩存一致性實現
所屬分類：技術論文
上傳者：aet
文檔大小：202 K
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文檔介紹：基于IP可重用的設計方法,利用WISHBONE總線協(xié)議,把兩個已成功開發(fā)出的具有自主知識產權的THUMP內核集成在一個芯片上,實現了片上多處理器FPGA。開發(fā)重點是實現基于片內WISHBONE總線的高速緩存一致性協(xié)議。
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