適用于嵌入式系統的AES加密IP核設計
所屬分類：技術論文
上傳者：aet
文檔大小：311 K
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文檔介紹：介紹了AES加密標準的Rijndael實現方法,設計了一種適合應用于嵌入式系統32位數據界面時序緊湊的AES加密IP核.該IP核能以較低的資源消耗實現在低端FPGA上速度為256Mb/s的AES加密,且可將數據位寬擴展為64位或128位等,滿足多種數據位寬應用的要求.該設計是一種低成本高性能的AES加密實現方法.
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