基于FPGA與DDR2SDRAM的高速ADC采樣數據緩沖器設計
所屬分類：技術論文
上傳者：serena
文檔大小：508 K
標簽： 接口IC
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文檔介紹：介紹了一種基于現場可編程門陣列(FPGA) 和第二代雙倍數據率同步動態隨機存取記憶體(DDR2) 的高速模數轉換(ADC) 采樣數據緩沖器設計方法,論述了在Xilinx V5 FPGA 中如何實現高速同步時鐘設計和高速數據同步接收設計。
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