Motion JPEG視頻壓縮IP核的設(shè)計(jì)與實(shí)現(xiàn)
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文檔介紹：本文設(shè)計(jì)了一個(gè)高效的全流水線結(jié)構(gòu)的Motion JPEG視頻壓縮IP核。在設(shè)計(jì)中提出了一種適合FPGA結(jié)構(gòu)的并行快速矩陣轉(zhuǎn)置電路結(jié)構(gòu)和全流水線的二維離散余弦變換電路結(jié)構(gòu)。在Altera公司的CycloneII系列芯片上搭建了包含NIOS II處理器和Motion JPEG視頻壓縮IP核在內(nèi)的SOPC結(jié)構(gòu)的驗(yàn)證系統(tǒng)。實(shí)驗(yàn)測(cè)得Motion JPEG視頻壓縮IP核可在50Mhz的時(shí)鐘頻率完成對(duì)NTSC制視頻中亮度分量的實(shí)時(shí)壓縮，在100Mhz的時(shí)鐘頻率完成對(duì)952×568連續(xù)亮度圖像的實(shí)時(shí)壓縮，幀率達(dá)147frame/s。實(shí)驗(yàn)結(jié)果表明Motion JPEG視頻壓縮IP核具有較大的實(shí)用價(jià)值和廣闊的應(yīng)用前景。
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