| H.264 baseline解碼器中運(yùn)動(dòng)補(bǔ)償模塊的硬件設(shè)計(jì) | |
| 所屬分類(lèi)：技術(shù)論文 | |
| 上傳者：aet | |
| 文檔大小：129 K | |
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| 文檔介紹：完成了H.264 baseline解碼器中運(yùn)動(dòng)補(bǔ)償模塊的Verilog建模，通過(guò)了功能驗(yàn)證和綜合。該運(yùn)動(dòng)補(bǔ)償模塊可用于H.264 baseline解碼器的FPGA實(shí)現(xiàn)和ASIC實(shí)現(xiàn)。 | |
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