| 直接數(shù)字頻率合成器DDS的優(yōu)化設(shè)計 | |
| 所屬分類：技術(shù)論文 | |
| 上傳者：aet | |
| 文檔大小：152 K | |
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| 文檔介紹：在深入理解DDS基本原理的基礎(chǔ)上，采用多級流水線控制技術(shù)對DDS的VHDL語言實現(xiàn)進行了優(yōu)化，并進行了異步接口的同步化設(shè)計，給出了DDS系統(tǒng)的時序仿真結(jié)果及其在FPGA中的資源占有率。 | |
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