基于AVS的變字長解碼器的設計及其FPGA驗證
所屬分類：技術論文
上傳者：aet
文檔大小：232 K
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文檔介紹：提出了一個完整的AVS變字長解碼器的硬件架構，在設計中采用加入FIFO的方法構成流水結構，并盡量減少變字長解碼器中各子模塊的運行節拍，大大提高了系統的運行速度。本設計已經通了FPGA驗證。該變字長解碼器不僅可以成為其他AVS解碼器的硬件加速器，同時由于視頻編解碼標準的相似性，稍加改動即可應用在其他的視頻標準中。
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